实验五 组合逻辑电路分析1
2024-04-23 13:28:52 7.03MB doc文档
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一、(1)实现计数式数字频率计和测周式数字频率计的功能; (2)静态 6 位 LED 数码管显示 8 位数字,分两屏显示,由按键SHIFT切换; (3) 测量频率:1Hz~99.999999MHz。 二、(1)实现交通灯信号灯自动控制循环功能; (2)静态 6 位七段 LED 显示器的最左 2 位和最右 2 位分别显示主道和次道当前状态所剩余时间; (3)用 LEDR0-LEDR9 的不同点亮组合表示道路四种通行状态; (4) 黄灯亮时,发出声响,进行报警提示。用 500Hz 的音频信号来驱动耳机,并采用间歇方式发出报警音,即以 1 秒为周期,前 0.5 秒发音、后 0.5 秒静音,最后一声报警音则输出 1kHz 音频信号。
2024-03-04 17:03:28 23.66MB 数字逻辑电路设计
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数字逻辑电路分析与设计.pdf英文影印版
2024-01-20 23:51:21 4.81MB
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广工数字逻辑与EDA设计组合逻辑电路实验报告
2024-01-04 17:15:39 21.16MB
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2023-09-07 15:39:10 24.9MB VHDL 数字逻辑电路
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本文设计了一套基于DSP的阵列声波信号采集与处理系统,此系统将作为正在研制的阵列声波测井仪中的一部分,应用于油田勘探中。
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2023-01-16 12:43:59 2.07MB 数电
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1.加深理解组合逻辑电路的特点和一般分析方法; 2.熟悉组合逻辑电路的设计方法; 3.验证半加器、全加器的功能。
2022-12-31 14:18:30 109KB 数字逻辑 半加器 全加器
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利用组合逻辑电路设计电路来解决加法器减法器的应用
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数字逻辑电路与设计课程的实验仿真文件(Multisim) 仿真软件(Multisim 13.0) 适合人群:数字逻辑电路与设计初学者 实验包括: 与门,非门,或门,异或门,同或门; 74LS138逻辑功能测试; JK触发器; 逻辑转换器; 全加器; 三人表决器; 设计1位数值比较电路; 四选一数据选择器; 译码器和与非门组成的三人表决器; 与非门组成或非门F=AB+CD;
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