SHA-256的一种verilogHDL实现
SHA-256的一种verilogHDL实现，包括testbench，quartusII可综合。SHA是一种数据加密算法，该算法经过加密专家多年来的发展和改进已日益完善，现在已成为公认的最安全的散列算法之一，并被广泛使用。该算法的思想是接收一段明文，然后以一种不可逆的方式将它转换成一段（通常更小）密文，也可以简单的理解为取一串输入码（称为预映射或信息），并把它们转化为长度较短、位数固定的输出序列即散列值（也称为信息摘要或信息认证代码）的过程。
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评论信息
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rainden :简单看了看， 代码还没综合！谢谢分享2018-08-07 -
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hitcszhu :不错，有空要学一下verilogHDL2017-09-19
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sailor001 :看起来挺简单的阿2017-07-04
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zhu0915251058 :深度不够呀，分析得不是很好。2016-05-18
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中国的孩子 :这段代码还不错,,2014-04-23
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