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PLL例化配置与LED之PLL的IP核配置
PLL例化配置与LED之PLL的IP核配置
上传者:
38691669
|
上传时间: 2024-04-01 23:56:38
|
文件大小: 64KB
|
文件类型: PDF
PLL例化配置
硬件设计
EDA软件
FPGA
本实例使用了一个PLL的硬核IP模块。关于PLL,这里简单的做些基础扫盲。PLL(Phase Locked Loop),即锁相回路或锁相环。PLL用于振荡器中的反馈技术。许多电子设备要正常工作,通常需要外部的输入信号与内部的振荡信号同步,利用锁相环路就可以实现这个目的。
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