采用Verilog编写的SPI_core

上传者: thereywb | 上传时间: 2019-12-21 21:14:53 | 文件大小: 4KB | 文件类型: zip
这是一个采用Verilog编写的SPI核,能够实现16位数据的传输,传输数据的宽度用户可以修改,同时我也为该核编写了测试文件,使用非常方便。该IP核代码,经过简单修改就能够使用,非常适合想了解和学习SPI总线的朋友。

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[{"title":"( 4 个子文件 4KB ) 采用Verilog编写的SPI_core","children":[{"title":"SPI_Core","children":[{"title":"spi_tb.v <span style='color:#111;'> 5.03KB </span>","children":null,"spread":false},{"title":"Receive_spi.v <span style='color:#111;'> 4.58KB </span>","children":null,"spread":false},{"title":"Send_spi.v <span style='color:#111;'> 3.42KB </span>","children":null,"spread":false},{"title":"spi_module.v <span style='color:#111;'> 1024B </span>","children":null,"spread":false}],"spread":true}],"spread":true}]

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