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verilog 数字跑表代码
verilog 数字跑表代码
上传者:
changengchu3961
|
上传时间: 2019-12-21 19:32:26
|
文件大小: 2KB
|
文件类型: v
计时器fpga
用verilog HDL编写的一个具有“百分秒、秒、分”计时功能的数字跑表,可以实现一个小时以内精确至百分之一秒的计时,注释比较清晰,容易看懂,还可以增加小时的计时功能
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